bus cycle

bus cycle
цикл шины
последовательность тактовых сигналов, управляющих работой шины. Для каждой конкретной шины начало и конец цикла определяются её конструктивными особенностями. Обычный цикл шины длится два такта: на первом такте процессор выставляет на шине адрес памяти, на втором - память возвращает запрашиваемые данные, если память не успевает выставить данные, возникает состояние ожидания (wait state)

Англо-русский толковый словарь терминов и сокращений по ВТ, Интернету и программированию. . 1998-2007.

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